《可编程ASIC技术》在线作业3
试卷总分：100
单选题
一、单选题（共 20 道试题，共 100 分。）
V
1. 在EDA设计过程中的仿真有几种，下面错误的是（）。
A. 行为仿真
B. 功能仿真
C. Matlab仿真
D. 时序仿真
满分：5 分
2. VHDL对象包含有专门数据类型，下面选项属于对象的是（）。
A. 文件
B. 结构
C. 类
D. 事件
满分：5 分
3. 信号代入语句分3种类型，它们是（）。
A. 并发信号代入语句、条件信号代入语句与串行信号代入语句
B. 并发信号代入语句、条件信号代入语句与选择信号代入语句
C. 一般信号代入语句、内部信号代入语句与外部信号代入语句
D. 敏感信号代入语句、同步信号代入语句与异步信号代入语句
满分：5 分
4. 仿真的关键是（）。
A. 仿真器
B. 电路结构
C. 模型
D. 延迟
满分：5 分
5. VHDL的基础建立在三个相互独立的模型上，分别是（）。
A. 行为模型
B. 时间模型
C. 结构模型
D. 以上都是
此题选: D 满分：5 分
6. FPGA有专用配置模式（）来配置。
A. 数据
B. 算法
C. 逻辑
D. 引脚
此题选: D 满分：5 分
7. 为了描述行为可利用电路级的转移函数和（）及逻辑级的布尔表达式和状态图。
A. 模块单元
B. 时序图
C. 芯片
D. 版图
满分：5 分
8. 基于硬件描述语言的数字系统设计流程是（）。
A. 系统描述(Specification or Requirements), 功能设计(Function design), RTL设计(Register transfer level design), 逻辑设计(logic design), 电路设计(circuit design), 物理设计(physical design), Description for Manufacture or Layout
B. 系统描述、功能设计、逻辑设计、电路设计、物理设计、设计验证(design verification)、芯
满分：5 分
9. 关于ASIC设计，下面选项不属于其三要素的是（）。
A. 设计者必须掌握一种硬件描述语言，来表达设计目的和设计要求
B. 设计者必须掌握一种高级程序设计语言，来加深对软硬件设计的理解
C. ASIC设计实现在实验室中进行时，设计者必须掌握FPGA器件结构；ASIC设计在集成电路制造工厂中实现时，设计者必须掌握代工厂的制造工艺，遵循其设计规则
D. 设计者必须掌握集成电路逻辑设计综合工具、波形仿真工具和集成电路版图设计工具
满分：5 分
10. （）正在变成一个吸引人的特性来帮助富有经验的系统制造者更安全和更有效地测试其PCB板。
A. TCK
B. TMS
C. 边界扫描
D. TDI/TDO
满分：5 分
11. （）是指用以生成用户可编程转换的物理技术。
A. ASIC器件
B. 编程技术
C. EPROM
D. Flash
满分：5 分
12. 库的好处在于（）。
A. 使设计者可以共享已经编译过的设计结果
B. 模块设计
C. Top-Down设计
D. 功能设计
满分：5 分
13. IP的重复使用分为三个层次，下面选项不属于这三个层次的是（）。
A. 软件宏单元
B. 固件宏单元
C. 硬件宏单元
D. 嵌入式IP
此题选: D 满分：5 分
14. 下面的语言不属于硬件描述语言的是（）。
A. VHDL与Verilog HDL
B. C#与JAVA
C. Superlog与C Level
D. ABEL HDL与System C
满分：5 分
15. VHDL语句的并发执行分为两类，它们是（）。
A. 信号并发执行与选择并发执行
B. 结构和行为并发执行
C. 无条件并发执行与有条件并发执行
D. 过程和进程中的并发执行
满分：5 分
16. Synopsys最著名的是ASIC（）。
A. 逻辑综合器
B. Xilinx ISE
C. Verilog HDL
D. Altera
满分：5 分
17. 当今可配置逻辑器件的功能单元有（）。
A. 基于熔丝/反熔丝技术的可编程元件
B. 开关
C. RAM查找表、基于多路开关的功能单元、固定功能的功能单元
D. 布线资源
满分：5 分
18. 可把综合过程分为两个阶段，分别是（）。
A. 工艺无关的综合阶段和工艺映射阶段
B. 优化阶段与影射阶段
C. 抽象与映射阶段
D. 逻辑优化
满分：5 分
19. 嵌入式IP核指可编程IP模块，主要是（）。
A. CPU与DSP
B. 存储器与控制器
C. 通用接口电路
D. 通用功能模块
满分：5 分
20. 在FPGA器件中，元件的（）把逻辑单元约束到器件的物理单元上。
A. 布局
B. 布线
C. 综合
D. 状态机
满分：5 分
试卷总分：100
单选题
一、单选题（共 20 道试题，共 100 分。）
V
1. 在EDA设计过程中的仿真有几种，下面错误的是（）。
A. 行为仿真
B. 功能仿真
C. Matlab仿真
D. 时序仿真
满分：5 分
2. VHDL对象包含有专门数据类型，下面选项属于对象的是（）。
A. 文件
B. 结构
C. 类
D. 事件
满分：5 分
3. 信号代入语句分3种类型，它们是（）。
A. 并发信号代入语句、条件信号代入语句与串行信号代入语句
B. 并发信号代入语句、条件信号代入语句与选择信号代入语句
C. 一般信号代入语句、内部信号代入语句与外部信号代入语句
D. 敏感信号代入语句、同步信号代入语句与异步信号代入语句
满分：5 分
4. 仿真的关键是（）。
A. 仿真器
B. 电路结构
C. 模型
D. 延迟
满分：5 分
5. VHDL的基础建立在三个相互独立的模型上，分别是（）。
A. 行为模型
B. 时间模型
C. 结构模型
D. 以上都是
此题选: D 满分：5 分
6. FPGA有专用配置模式（）来配置。
A. 数据
B. 算法
C. 逻辑
D. 引脚
此题选: D 满分：5 分
7. 为了描述行为可利用电路级的转移函数和（）及逻辑级的布尔表达式和状态图。
A. 模块单元
B. 时序图
C. 芯片
D. 版图
满分：5 分
8. 基于硬件描述语言的数字系统设计流程是（）。
A. 系统描述(Specification or Requirements), 功能设计(Function design), RTL设计(Register transfer level design), 逻辑设计(logic design), 电路设计(circuit design), 物理设计(physical design), Description for Manufacture or Layout
B. 系统描述、功能设计、逻辑设计、电路设计、物理设计、设计验证(design verification)、芯
满分：5 分
9. 关于ASIC设计，下面选项不属于其三要素的是（）。
A. 设计者必须掌握一种硬件描述语言，来表达设计目的和设计要求
B. 设计者必须掌握一种高级程序设计语言，来加深对软硬件设计的理解
C. ASIC设计实现在实验室中进行时，设计者必须掌握FPGA器件结构；ASIC设计在集成电路制造工厂中实现时，设计者必须掌握代工厂的制造工艺，遵循其设计规则
D. 设计者必须掌握集成电路逻辑设计综合工具、波形仿真工具和集成电路版图设计工具
满分：5 分
10. （）正在变成一个吸引人的特性来帮助富有经验的系统制造者更安全和更有效地测试其PCB板。
A. TCK
B. TMS
C. 边界扫描
D. TDI/TDO
满分：5 分
11. （）是指用以生成用户可编程转换的物理技术。
A. ASIC器件
B. 编程技术
C. EPROM
D. Flash
满分：5 分
12. 库的好处在于（）。
A. 使设计者可以共享已经编译过的设计结果
B. 模块设计
C. Top-Down设计
D. 功能设计
满分：5 分
13. IP的重复使用分为三个层次，下面选项不属于这三个层次的是（）。
A. 软件宏单元
B. 固件宏单元
C. 硬件宏单元
D. 嵌入式IP
此题选: D 满分：5 分
14. 下面的语言不属于硬件描述语言的是（）。
A. VHDL与Verilog HDL
B. C#与JAVA
C. Superlog与C Level
D. ABEL HDL与System C
满分：5 分
15. VHDL语句的并发执行分为两类，它们是（）。
A. 信号并发执行与选择并发执行
B. 结构和行为并发执行
C. 无条件并发执行与有条件并发执行
D. 过程和进程中的并发执行
满分：5 分
16. Synopsys最著名的是ASIC（）。
A. 逻辑综合器
B. Xilinx ISE
C. Verilog HDL
D. Altera
满分：5 分
17. 当今可配置逻辑器件的功能单元有（）。
A. 基于熔丝/反熔丝技术的可编程元件
B. 开关
C. RAM查找表、基于多路开关的功能单元、固定功能的功能单元
D. 布线资源
满分：5 分
18. 可把综合过程分为两个阶段，分别是（）。
A. 工艺无关的综合阶段和工艺映射阶段
B. 优化阶段与影射阶段
C. 抽象与映射阶段
D. 逻辑优化
满分：5 分
19. 嵌入式IP核指可编程IP模块，主要是（）。
A. CPU与DSP
B. 存储器与控制器
C. 通用接口电路
D. 通用功能模块
满分：5 分
20. 在FPGA器件中，元件的（）把逻辑单元约束到器件的物理单元上。
A. 布局
B. 布线
C. 综合
D. 状态机
满分：5 分
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