14春福建师范大学《EDA技术》在线作业二

福师《EDA技术》在线作业二
试卷总分：100 奥鹏学习网（aopeng123.cn) 发布
多选题
判断题
一、多选题（共 10 道试题，共 20 分。）
V
1. 综合有哪几种形式()。
A. RTL
B. 逻辑综合
C. 将逻辑门表示转换到版图表示
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2. 布局布线完成后会产生哪些文件（）。
A. 芯片资源耗用的报告
B. EDIF
C. 延时网表
D. 器件编程文件
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3. 下面哪些是专业提供PLD器件厂商（）。
A. Xilinx
B. Altera
C. Lattice
D. Micsoftware
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4. 用PLD器件实现设计的优势有哪些（）？
A. 周期短
B. 投入少
C. 风险小
D. 对于成熟的设计往往采用PLD
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5. ASIC电路特点描述正确的是（）。
A. 周期长
B. 投入高
C. 功耗低
D. 省面积
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6. 基于EDA技术的设计中，通常有两种设计思路（）。
A. 自顶向下
B. 自底向上
C. 自前向后
D. 自后向前
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7. 目前常用的硬件描述语言为：（）。
A. Verilog
B. VHDL
C. 和 VC
D. VB
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8. PLD是一种半定制器件，主要包括（）。
A. FPGA
B. CPLD
C. CPU
D. ASIC
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9. 状态机常用的编码方式有（）。
A. 顺序编码
B. 格雷编码
C. 约翰逊编码
D. 一位热码
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10. EDA技术发展阶段描述正确的是（）。
A. CAD阶段
B. CAE阶段
C. EDA阶段
D. 以上都不对
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福师《EDA技术》在线作业二
试卷总分：100 奥鹏学习网（aopeng123.cn) 发布
多选题
判断题
二、判断题（共 40 道试题，共 80 分。）
V
1. 不考虑信号时延等因素的仿真称为功能仿真。
A. 错误
B. 正确
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2. 仿真器按对设计语言的不同处理方式分为两类：编译型仿真器和解释型仿真器。
A. 错误
B. 正确
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3. CPLD和FPGA都属于高密度可编程逻辑器件。
A. 错误
B. 正确
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4. 如果只需要在上电和系统错误时进行复位操作，采用异步复位方式比同步复位方式好。
A. 错误
B. 正确
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5. Verilog HDL支持条件运算符。
A. 错误
B. 正确
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6. Verilog HDL不支持条件语句。
A. 错误
B. 正确
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7. 浮栅编程元件一般用在民用、消费类产品中。
A. 错误
B. 正确
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8. 硬件综合器和软件程序编译器没有本质区别。
A. 错误
B. 正确
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9. Verilog HDL数据类型是用来表示数字电路中的物理连线、数据存储和传输单元等物理量的。
A. 错误
B. 正确
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10. 把适配后生成的编程文件装入到PLD器件中的过程称为下载。
A. 错误
B. 正确
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11. 数字设计流程中采用原理图方式适合描述电路的连接关系核接口关系。
A. 错误
B. 正确
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12. Verilog HDL中整数型常量是不可以综合的。
A. 错误
B. 正确
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13. PROM(Programmable Read－Only Memory），可编程只读存储器的缩写。
A. 错误
B. 正确
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14. 目前常用的硬件描述语言为：Verilog HDL和 VHDL。
A. 错误
B. 正确
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15. HDL是一种用文本形式来描述和设计电路的语言。
A. 错误
B. 正确
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16. Verilog语言的行为描述语句，如条件语句、赋值语句和循环语句类似于软件高级语言，便于学习和使用。
A. 错误
B. 正确
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17. 仿真是EDA的精髓所在。
A. 错误
B. 正确
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18. 行为描述就是对设计实体的数学模型的描述，其抽象程度远高于结构描述。
A. 错误
B. 正确
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19. PLA是Programmable Logic Array,可编程逻辑阵列的缩写。
A. 错误
B. 正确
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20. 数据流描述方式多用于组合逻辑电路。
A. 错误
B. 正确
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21. GAL是Generic Array Logic,通用阵列逻辑的缩写。
A. 错误
B. 正确
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22. 编译型仿真器的仿真速度快，但需要预处理，不能即时修改。
A. 错误
B. 正确
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23. ISP和专用的编程器是FPGA常用的两种编程方式。
A. 错误
B. 正确
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24. 用状态机进行设计具有速度快、结构简单、可靠性高等优点。
A. 错误
B. 正确
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25. Alter的FPGA器件主要由两类配置方式：主动配置方式和被动配置方式。
A. 错误
B. 正确
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26. CAE是Computer Aided Engineering,计算机辅助工程的缩写。
A. 错误
B. 正确
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27. 综合指的是将较高级抽象层次的设计描述自动转化为较低层次描述的过程。
A. 错误
B. 正确
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28. 仿真分为功能仿真和时序仿真。
A. 错误
B. 正确
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29. Verilog HDL和 VHDL目前还都不是IEEE标准。
A. 错误
B. 正确
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30. EDA是Electronic Design Automation,电子设计自动化的缩写。
A. 错误
B. 正确
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31. 混合仿真器就是能同时支持Verilog和VHDL的仿真器。
A. 错误
B. 正确
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32. 状态机设计主要包含三个对象：当前状态，次状态和输出逻辑。
A. 错误
B. 正确
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33. JTAG边界扫描测试技术提供了一种合理而有效的方法，用以对高密度、引脚密集的器件和系统进行测试。
A. 错误
B. 正确
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34. 在EDA设计中一般采用硬件描述语言(HDL)进行电路与系统的描述。
A. 错误
B. 正确
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35. Verilog HDL语法要素与软件编程语言（如C语言）是完全相同的。
A. 错误
B. 正确
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36. CPLD是Complex Programmable Logic Device,复杂可编程逻辑器件的缩写。
A. 错误
B. 正确
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37. Verilog HDL中的变量一般分为两种数据类型：net型和variable型。
A. 错误
B. 正确
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38. 时序仿真也叫后仿真。
A. 错误
B. 正确
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39. Verilog HDL中的常量主要有：整数，实数和字符串
A. 错误
B. 正确
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40. PLD器件的设计往往采用层次化的设计方法，分模块，分层次地进行设计描述。
A. 错误
B. 正确
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