福建师范大学2021年8月课程考试《EDA技术》作业考核试题

福建师范大学 EDA技术 温度: 时间:2021-07-29 12:00:04
《EDA技术》期末考试A卷  5p7奥鹏作业学习网(aopeng123.cn)
姓名:                     专业:5p7奥鹏作业学习网(aopeng123.cn)
学号:                     学习中心:    成绩: 第一题:填空题(每题3分,共30分,)5p7奥鹏作业学习网(aopeng123.cn)
1.        EDA技术的发展分为              、          和___________三个阶段。5p7奥鹏作业学习网(aopeng123.cn)
2.        EDA的设计输入主要包括            、          、          。5p7奥鹏作业学习网(aopeng123.cn)
3.        当前最流行的并成为IEEE标准的硬件描述语言包括:   _____和       。5p7奥鹏作业学习网(aopeng123.cn)
4.        有三种端口类型,分别是          、___     _和           。5p7奥鹏作业学习网(aopeng123.cn)
5.        输入和双向端口不能声明为                         型。5p7奥鹏作业学习网(aopeng123.cn)
6.        在常量表达示中,二进制是用       字母表示,八进制是用       字母表示,十六进制是用       字母表示。5p7奥鹏作业学习网(aopeng123.cn)
7.        宽度为1位的变量称为          ,如果在变量声明中没有指定位宽,则默认为        。线宽大于1位的变量(包括net型和variable型)称为             。5p7奥鹏作业学习网(aopeng123.cn)
8.        表达式:8`h55&&8`haa 的值为       ,表达式:8`h55 & 8`haa的值为多少         。5p7奥鹏作业学习网(aopeng123.cn)
9.语句 out=sel?inl:in0; 表示的意义是:                。   5p7奥鹏作业学习网(aopeng123.cn)
10.语句{3{a,b}} 表示的意义是:                          。5p7奥鹏作业学习网(aopeng123.cn)
第二题:(每题5分,共20分)5p7奥鹏作业学习网(aopeng123.cn)
1.        什么是IP复用技术?IP核对EDA技术的应用和发展有什么意义?5p7奥鹏作业学习网(aopeng123.cn)
2.        基于FPGA/CPLD的数字系统没计流程包括哪些步骤?5p7奥鹏作业学习网(aopeng123.cn)
3.        说明GAL的OLMC有什么特点,它怎样实现可编程组合电路和时序电路?5p7奥鹏作业学习网(aopeng123.cn)
4.        阻塞赋值和非阻塞赋值有什么本质的区别?5p7奥鹏作业学习网(aopeng123.cn)
第三题:程序分析题(每题15分,共30分)5p7奥鹏作业学习网(aopeng123.cn)
1.        分析程序并画出逻辑电路图及逻辑表达式:5p7奥鹏作业学习网(aopeng123.cn)
module AOI(A,B,C,D,F);        5p7奥鹏作业学习网(aopeng123.cn)
input A,B,C,D; 5p7奥鹏作业学习网(aopeng123.cn)
output F; 5p7奥鹏作业学习网(aopeng123.cn)
wire A,B,C,D,F;         5p7奥鹏作业学习网(aopeng123.cn)
assign F=~((A&B) | (~(C&D)));5p7奥鹏作业学习网(aopeng123.cn)
endmodule5p7奥鹏作业学习网(aopeng123.cn)
2.        详细分析下面程序功能:5p7奥鹏作业学习网(aopeng123.cn)
module count(out,data, load, reset,clk) ;5p7奥鹏作业学习网(aopeng123.cn)
input load,clk,reset;  5p7奥鹏作业学习网(aopeng123.cn)
input[7:0]  data;5p7奥鹏作业学习网(aopeng123.cn)
output[7:0]  out;  5p7奥鹏作业学习网(aopeng123.cn)
reg[7:0]  out;5p7奥鹏作业学习网(aopeng123.cn)
always @  (posedge clk)                                 5p7奥鹏作业学习网(aopeng123.cn)
begin5p7奥鹏作业学习网(aopeng123.cn)
        if ( !reset)    out<=8'h00 ;         5p7奥鹏作业学习网(aopeng123.cn)
else if (load)  out<=data;                 5p7奥鹏作业学习网(aopeng123.cn)
else            out<=out+1 ;        5p7奥鹏作业学习网(aopeng123.cn)
end5p7奥鹏作业学习网(aopeng123.cn)
endmodule5p7奥鹏作业学习网(aopeng123.cn)
第四题:设计题(每题20分,共20分,请在主观题区答题)5p7奥鹏作业学习网(aopeng123.cn)
用Verilog HDL设计一个74138的译码器电路。5p7奥鹏作业学习网(aopeng123.cn)
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